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SI-Designer 可以让设计人员直观发现设计中的问题和缺陷，及时调整改进，从而有效解决高速信号完整性问题。
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TJSPICE是业界领先的具有golden级别精度的SPICE仿真器，可以进行芯片模型库、IO电路设计等仿真验证。
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巨霖发布信号完整性仿真平台SIDesigner
发布时间：2021.11.29
随着芯片产业的蓬勃发展，市场对数据传输速率的需求也与日俱增。Signal Integrity（SI）又称信号完整性，是一种面向信号传送质量的分析领域，即在互连通路中保持信号的完整传递，使芯片工作不受影响。如今，产品的信号速率动辄高达数Gbps，信号波长已小于结构几何尺寸。信号传送以电磁波方式行进时，就必须考虑波的反射、传播以及干扰，当前，信号传送时产生的高频现象已成为信号完整性设计中不可忽略的因素。因此，芯片设计需要测试，检查具体实施过程中是否满足了最初定义的电源（power）、性能和可靠性，这也是检测最终产品是否符合预期的基本依据。
专注于信号和电源完整性应用开发的巨霖发布了基于GUI的通用电路仿真平台SIDesigner，其内置达到业界精度标准SPICE引擎的级别。SIDesigner可以进行快速假设性分析，以便在预布局阶段就可从信号完整性和电源完整性角度获得最佳布局。借助于第三方3D全波建模工具，SIDesigner可以完成所有信号完整性时序签核仿真工作（signal integrity timing sign-off simulation work）。
此外，由于在SIDesigner中可自由进行电路拓扑搭建，因此信号完整性与电源完整性协同仿真变得尤为便利，简单的拖放操作后即可完成。同时，SIDesigner还支持由任何常见电路元素类型组成的通用电路仿真。
SIDesigner主要功能：
SIDesigner简单易用的流程，不仅可以帮助初级工程师快速熟悉信号完整性和电源完整性分析流程，也能为资深工程师节省大量流程设置时间。
通过内置行业标准SPICE 引擎，SIDesigner可支持所有并行接口的SI-PI协同分析。用户可通过对设计参数进行详尽的假设分析获取最佳设计方案。
SIDesigner支持所有常用电路元素，用户可以轻松搭建电源分配网络进行AC/DC/瞬态分析。
同时其还支持VRM模型和芯片电源模型(CPM)用于系统级电源完整性分析。
通过自由组合PDN的不同部分，可以轻松通过假设分析优化PDN设计。SIDesigner支持通用电路拓扑仿真，用户能仿真他们想要验证的任何内容并帮助提高设计性能，其不受限于预先构建的信道块和拓扑。
